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ST10F273M-4Q3-ST10F273M-4T3 Fast Delivery,Good Price
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ST10F273M-4Q3 |ST10F273M4Q3STN/a31avai16-bit MCU with 512 Kbyte Flash memory and 36 Kbyte RAM
ST10F273M-4T3 |ST10F273M4T3STN/a100avai16-bit MCU with 512 Kbyte Flash memory and 36 Kbyte RAM


ST10F273M-4T3 ,16-bit MCU with 512 Kbyte Flash memory and 36 Kbyte RAMFeatures■ High performance 16-bit CPU with DSP functions– 50ns instruction cycle time at 40 MHz max ..
ST10F276Z5Q3 ,16-BIT MICROCONTROLLER WITH MAC UNIT, UP TO 832 KBYTES FLASH MEMORY AND UP TO 68 KBYTES RAMFeatures■ Highly performance 16-bit CPU with DSP functions– 31.25 ns instruction cycle time at 64 M ..
ST10F280-Q3TR ,16-BIT MCU WITH MAC UNITFeatures 406.1.1.1 - Enhanced Addressing Capabilities...... 406.1.1.2 - Multiply-Accumulate Unit . ..
ST10F280-Q3TR ,16-BIT MCU WITH MAC UNITST10F28016-BIT MCU WITH MAC UNIT, 512K BYTE FLASH MEMORY AND 18K BYTE RAMPRODUCT PREVIEW■ HIGH PERF ..
ST10R167-Q3 ,16-BIT MCUST10C16716-BIT MCU WITH 32K BYTE ROM■ HIGH PERFORMANCE CPU – 16-BIT CPU WITH 4-STAGE PIPELINE– 80ns ..
ST10R167-Q6 ,16-BIT MCUABSOLUTE MAXIMUM RATINGS ..... 3820.2 PARAMETER INTERPRETATION ..... 3820.3 DC CHARACTERISTICS . 38 ..
STK4843 ,2-Channel 10 To 50W Min AF Power AMP(Dual Supply)FeaturesI STK5321 STK5322 STK5324Output 1: 9.5i0.1V (1.6A) 9.5i0.1V (1.6A) 12.0iO.1V (1.6A) 1Output ..
STK4843 ,2-Channel 10 To 50W Min AF Power AMP(Dual Supply)FeaturesI AF Output Power STK4773: 10Wmin. STK4793: 15Wmin.STK4813: 20Wmin. STK4833: 25Wmin.STK4853 ..
STK4873 ,THICK FILM HYBRID INTEQRATED CIRCUIT 35W MIN 2-CHANNEL AF POWER AMP(DUAL SUPPLY)
STK4913 ,Thick Film Hybid Circuit 2-Channel 50W Min AF Power Amp
STK4913 ,Thick Film Hybid Circuit 2-Channel 50W Min AF Power Amp
STK5314 ,Thick Film Hybrid Integrated Circuit VOLTAGE REGULATORNo. 1146STK5314Thick Film Hybrid Integrated Ci rcuitVOLTAGE REGULATOR


ST10F273M-4Q3-ST10F273M-4T3
16-bit MCU with 512 Kbyte Flash memory and 36 Kbyte RAM
September 2013 Doc ID 13453 Rev 4 1/186
ST10F273M

16-bit MCU with 512 Kbyte Flash memory and 36 Kbyte RAM
Datasheet − production data
Features
High performance 16-bit CPU with DSP
functions 50ns instruction cycle time at 40 MHz max
CPU clock Multiply/accumulate unit (MAC) 16 x 16-bit
multiplication, 40-bit accumulator Enhanced boolean bit manipulations Single-cycle context switching support Memory organization 512 Kbyte on-chip Flash memory single
voltage with erase/program controller (full
performance, 32-bit fetch) 100 K erasing/programming cycles Up to 16 Mbyte linear address space for
code and data (5 Mbytes with CAN or I2C) 2 Kbyte on-chip internal RAM (IRAM) 34 Kbyte on-chip extension RAM (XRAM) Programmable external bus configuration
and characteristics for different address
ranges 5 programmable chip-select signals Hold-acknowledge bus arbitration support Interrupt 8-channel peripheral event controller for
single cycle interrupt driven data transfer 16-priority-level interrupt system with 56
sources, sampling rate down to 25ns Timers 2 multifunctional general purpose timer
units with 5 timers Two 16-channel capture/ compare units 4-channel PWM unit + 4-channel XPWM 24-channel A/D converter 16-channel 10-bit, accuracy +/-2 LSB 8-channel 10-bit, accuracy +/-5 LSB 4.85µs Minimum conversion time Serial channels 2 synch./ asynch. serial channels 2 high-speed synchronous channels2 C standard interface 2 CAN 2.0B interfaces operating on 1 or 2 CAN
buses (64 or 2x32 messages, C-CAN version) Fail-safe protection Programmable watchdog timer Oscillator watchdog On-chip bootstrap loader Clock generation On-chip PLL and 4 to 12 MHz oscillator Direct or prescaled clock input Real time clock and 32 kHz on-chip oscillator Up to 111 general purpose I/O lines Individually programmable as input, output
or special function Programmable threshold (hysteresis) Idle, power down and standby modes Single voltage supply: 5 V ±10% (embedded
regulator for 1.8 V core supply) Temperature range: -40°C to 125°C
Contents ST10F273M
2/186 Doc ID 13453 Rev 4
Contents Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11

1.1 Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
1.2 Special characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
1.2.1 X-Peripheral clock gating . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
1.2.2 Improved supply ring . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11 Pin data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13 Functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20 Memory organization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21 Internal Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
5.1 Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
5.2 Functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
5.2.1 Structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
5.2.2 Module structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
5.2.3 Low power mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
5.3 Write operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
5.4 Flash control registers description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
5.4.1 Flash control register 0 low (FCR0L) . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
5.4.2 Flash control register 0 high (FCR0H) . . . . . . . . . . . . . . . . . . . . . . . . . . 33
5.4.3 Flash control register 1 low (FCR1L) . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
5.4.4 Flash control register 1 high (FCR1H) . . . . . . . . . . . . . . . . . . . . . . . . . . 36
5.4.5 Flash data register 0 low (FDR0L) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
5.4.6 Flash data register 0 high (FDR0H) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
5.4.7 Flash data register 1 low (FDR1L) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
5.4.8 Flash data register 1 high (FDR1H) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
5.4.9 Flash address register low (FARL) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
5.4.10 Flash address register high (FARH) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
5.4.11 Flash error register (FER) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
5.4.12 XFlash interface control dummy register (XFICR) . . . . . . . . . . . . . . . . . 40
5.5 Protection strategy . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
5.5.1 Protection registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
ST10F273M Contents
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5.5.2 Flash non-volatile write protection I register low (FNVWPIRL) . . . . . . . 41
5.5.3 Flash non-volatile write protection I register high (FNVWPIRH) . . . . . . 42
5.5.4 Flash non-volatile write protection I register low Mirror (FNVWPIRL-m) 42
5.5.5 Flash non-volatile write protection I register high Mirror (FVWPIRH-m) 42
5.5.6 Flash non-volatile access protection register 0 (FNVAPR0) . . . . . . . . . 43
5.5.7 Flash non-volatile access protection register 1 low (FNVAPR1L) . . . . . 43
5.5.8 Flash non-volatile access protection register 1 high (FNVAPR1H) . . . . 44
5.5.9 Access protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
5.5.10 Write protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
5.5.11 Temporary unprotection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
5.6 Write operation examples . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
5.7 Write operation summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48 Bootstrap loader . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49
6.1 Selection among user-code, standard or selective bootstrap . . . . . . . . . . 49
6.2 Standard bootstrap loader . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49
6.3 Alternate and selective boot mode (ABM and SBM) . . . . . . . . . . . . . . . . 50
6.3.1 Activation of the ABM and SBM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50
6.3.2 User mode signature integrity check . . . . . . . . . . . . . . . . . . . . . . . . . . . 50
6.3.3 Selective boot mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50 Central processing unit (CPU) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51
7.1 Multiplier-accumulator unit (MAC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52
7.2 Instruction set summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53
7.3 MAC co-processor specific instructions . . . . . . . . . . . . . . . . . . . . . . . . . . 55 External bus controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 56 Interrupt system . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57
9.1 X-Peripheral interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59
9.2 Exception and error traps list . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61 Capture / compare (CAPCOM) units . . . . . . . . . . . . . . . . . . . . . . . . . . . 62 General purpose timer unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64
11.1 GPT1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64
Contents ST10F273M
4/186 Doc ID 13453 Rev 4
11.2 GPT2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 66 PWM modules . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 68 Parallel ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69
13.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69
13.2 I/O’s special features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69
13.2.1 Open drain mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69
13.2.2 Input threshold control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70
13.3 Alternate port functions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70 A/D converter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72 Serial channels . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74
15.1 Asynchronous / synchronous serial interfaces . . . . . . . . . . . . . . . . . . . . . 74
15.2 ASCx in asynchronous mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74
15.3 ASCx in synchronous mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75
15.4 High speed synchronous serial interfaces . . . . . . . . . . . . . . . . . . . . . . . . 75 I2C interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77 CAN modules . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78
17.1 Configuration support . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78
17.2 CAN bus configurations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78
17.2.1 Single CAN bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79
17.2.2 Multiple CAN bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80
17.2.3 Parallel mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80 Real time clock . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81 Watchdog timer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82 System reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
20.1 Input filter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
20.2 Asynchronous reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84
20.3 Synchronous reset (warm reset) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89
ST10F273M Contents
Doc ID 13453 Rev 4 5/186
20.4 Software reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95
20.5 Watchdog timer reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 96
20.6 Bidirectional reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97
20.7 Reset circuitry . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101
20.8 Reset application examples . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104
20.9 Reset summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106 Power reduction modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109
21.1 Idle mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109
21.2 Power-down mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109
21.2.1 Protected power-down mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110
21.2.2 Interruptible power-down mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110
21.3 Standby mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110
21.3.1 Entering standby mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 111
21.3.2 Exiting standby mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
21.3.3 Real time clock and standby mode . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
21.3.4 Power reduction modes summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112 Programmable output clock divider . . . . . . . . . . . . . . . . . . . . . . . . . . 114 Register set . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115
23.1 Special function registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115
23.2 X-registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123
23.3 Flash registers ordered by name . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128
23.4 Identification registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128 Electrical characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 131
24.1 Absolute maximum ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 131
24.2 Recommended operating conditions . . . . . . . . . . . . . . . . . . . . . . . . . . . 132
24.3 Power considerations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 132
24.4 Parameter interpretation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 133
24.5 DC characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 134
24.6 Flash characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 138
24.7 A/D converter characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 139
24.7.1 Conversion timing control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 140
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