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PEB20590HV2.1 \|PEB20590HV21	INFINEON	N/a	40	avai	VIP (Versatile ISDN Port)
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PEB20590HV2.1 ,VIP (Versatile ISDN Port)Data Sheet, DS4, March 2001VIP, VIP-8Versatile ISDN PortPEB 20590 Version 2.1PEB 20591 Version 2.1W ..
PEB20591HV2.1 ,VIP-8 (Versatile ISDN Port)Data Sheet, DS4, March 2001VIP, VIP-8Versatile ISDN PortPEB 20590 Version 2.1PEB 20591 Version 2.1W ..
PEB2060NV4.5 ,SICOFI (Signal Processing Codec Filter)General DescriptionType PackageThe Signal Processing Codec Filter (SICOFI) PEB 2060 is a PEB 2060-N ..
PEB2060NV4.5 . ,SICOFI (Signal Processing Codec Filter)features such as • Band limitation according to CClTT and LSSGR programmable trans-hybrid balancing ..
PEB2060PV4.5 ,SICOFI (Signal Processing Codec Filter)feature control. Specific filter programming is done by downloading coefficients to the Coefficient ..
PEB2060PV4.5 ,SICOFI (Signal Processing Codec Filter)Featuresenables the control of the device’s analog behavior by digital • Single-chip codec and filt ..
PIC16F874A , 28/40/44-Pin Enhanced Flash Microcontrollers
PIC16F874A , 28/40/44-Pin Enhanced Flash Microcontrollers
PIC16F883 , 28/40/44-Pin, Enhanced Flash-Based 8-Bit CMOS Microcontrollers with nanoWatt Technology
PIC17C42A , High-Performance 8-Bit CMOS EPROM/ROM Microcontroller
PIC18F2525-I/SO , 28/40/44-Pin Enhanced Flash Microcontrollers with 10-Bit A/D and nanoWatt Technology
PIC18F2620-I/SO , 28/40/44-Pin Enhanced Flash Microcontrollers with 10-Bit A/D and nanoWatt Technology

PEB20590HV2.1-PEB20591HV2.1
VIP (Versatile ISDN Port)

VIP, VIP-8
Versatile ISDN Port
PEB 20590 Version 2.1
PEB 20591 Version 2.1
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Table of ContentsPageIntroduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
1.1Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
1.2Logic Symbol Diagrams . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6
1.3Typical Applications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7Pin Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
2.1Pin Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
2.2Pin Descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11Interface Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
3.1Overview of Interfaces . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
3.2UPN Line Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
3.2.1Frame Structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
3.2.2UPN Transceiver . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
3.2.3Receive PLL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
3.2.4Receive Signal Oversampling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
3.3S/T Line Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
3.3.1Frame Structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
3.3.2S/T Transceiver . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
3.3.3Receive Clock Recovery . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
3.3.3.1LT-S Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
3.3.3.2LT-T Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
3.3.4Reference Clock Selection in LT-T Mode . . . . . . . . . . . . . . . . . . . . . . . 28
3.3.5Receive Signal Oversampling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
3.3.6Elastic Buffer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
3.4IOM-2000 Interface Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
3.4.1IOM-2000 Frame Structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
3.4.1.1Data Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
3.5JTAG Boundary Scan Test Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
3.5.1TAP Controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34Operational Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
4.1General . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
4.2Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
4.3Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
4.4Analog Test Loops . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
4.5Monitoring of Code Violations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37Electrical Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
5.1Absolute Maximum Ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
5.2Operating Range . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
5.3DC Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
5.4Capacitances . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
5.5Recommended 15.36-MHz Crystal Parameters . . . . . . . . . . . . . . . . . . . . 41

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